WO2025113838 - ENTLADUNGSVORRICHTUNG ZUR ENTLADUNG EINES HOCHSPANNUNGSKREISES SOWIE EIN VERFAHREN ZUM ENTLADEN EINES HOCHSPANUNGSKREISES

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Publication Number WO/2025/113838
Publication Date 05.06.2025
International Application No. PCT/EP2024/075639
International Filing Date 13.09.2024
Title **
[German] ENTLADUNGSVORRICHTUNG ZUR ENTLADUNG EINES HOCHSPANNUNGSKREISES SOWIE EIN VERFAHREN ZUM ENTLADEN EINES HOCHSPANUNGSKREISES
[English] DISCHARGE DEVICE FOR DISCHARGING A HIGH-VOLTAGE CIRCUIT AND METHOD FOR DISCHARGING A HIGH-VOLTAGE CIRCUIT
[French] DISPOSITIF DE DÉCHARGE POUR DÉCHARGER UN CIRCUIT HAUTE TENSION ET PROCÉDÉ DE DÉCHARGE D'UN CIRCUIT HAUTE TENSION
Applicants **
ROBERT BOSCH GMBH
Inventors
GRAF, Marco
WALTER, Janes
Priority Data
102023211765.7   27.11.2023   DE
Application details
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EPO Filing, Examination, Granting8113
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USA Filing, Examination, Granting4740
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Abstract[German] Die vorliegende Erfindung schafft eine Entladungsvorrichtung (1) zur Entladung eines Hochspannungskreises mit einer Wechselrichter-Endstufe (2), die mindestens eine Halbbrücke (3a,3b,3c) aufweist, welche seriell verschaltete Halbleiterschalter (4a,5a,4b,5b,4c,5c) mit zugehörigen Treiberschaltungen (6a,7a,6b,7b,6c,7c) umfasst, und mit einem Prozessor (12), welcher über eine Schnittstelle mit den Treiberschaltungen (6a,7a,6b,7b,6c,7c) der Wechselrichter- Endstufe (2) verbunden ist, wobei jeder Halbleiterschalter (4a,5a,4b,5b,4c,5c) einen Steuereingang (8a,9a,8b,9b,8c,9c) hat, welcher dazu ausgelegt ist, ein Treibersignal von einer zugehörigen Treiberschaltung (6a,7a,6b,7b,6c,7c) der Wechselrichter-Endstufe (2) zu empfangen, wobei die Treiberschaltungen (6a,7a,6b,7b,6c,7c) der Wechselrichter-Endstufe (2) jeweils eine Sicherheitslogik (10a,11a,10b,11b,10c,11c) beinhalten, die dazu ausgelegt ist, über die Schnittstelle von dem Prozessor (12) der Entladungsvorrichtung (1) ein Konfigurationssignal zu empfangen, welches das durch die Treiberschaltung (6a,7a,6b,7b,6c,7c) an den zugehörigen Steuereingang (8a,9a,8b,9b,8c,9c) des Halbleiterschalters (4a,5a,4b,5b,4c,5c) abzugebende Treibersignal zur Entladung des Hochspannungskreises konfiguriert.[English] The present invention relates to a discharge device (1) for discharging a high-voltage circuit with an inverter output stage (2) which has at least one half-bridge (3a, 3b, 3c) which comprises serially connected semiconductor switches (4a, 5a, 4b, 5b, 4c, 5c) with associated driver circuits (6a, 7a, 6b, 7b, 6c, 7c), and with a processor (12) which is connected via an interface to the driver circuits (6a, 7a, 6b, 7b, 6c, 7c) of the inverter output stage (2), wherein each semiconductor switch (4a, 5a, 4b, 5b, 4c, 5c) has a control input (8a, 9a, 8b, 9b, 8c, 9c) which is designed to receive a driver signal from an associated driver circuit (6a, 7a, 6b, 7b, 6c, 7c) of the inverter output stage (2), wherein the driver circuits (6a, 7a, 6b, 7b, 6c, 7c) of the inverter output stage (2) each contain a safety logic (10a, 11a, 10b, 11b, 10c, 11c) which is designed to receive a configuration signal from the processor (12) of the discharge device (1) via the interface, which configuration signal configures the driver signal to be emitted by the driver circuit (6a, 7a, 6b, 7b, 6c, 7c) to the associated control input (8a, 9a, 8b, 9b, 8c, 9c) of the semiconductor switch (4a, 5a, 4b, 5b, 4c, 5c) in order to discharge the high-voltage circuit.[French] La présente invention concerne un dispositif de décharge (1) pour décharger un circuit haute tension avec un étage de sortie d'onduleur (2) qui comporte au moins un demi-pont (3a, 3b, 3c) qui comprend des commutateurs à semi-conducteur connectés en série (4a, 5a, 4b, 5b, 4c, 5c) avec des circuits d'attaque associés (6a, 7a, 6b, 7b, 6c, 7c), et avec un processeur (12) qui est connecté par l'intermédiaire d'une interface aux circuits d'attaque (6a, 7a, 6b, 7b, 6c, 7c) de l'étage de sortie d'onduleur (2). Chaque commutateur à semi-conducteur (4a, 5a, 4b, 5b, 4c, 5c) a une entrée de commande (8a, 9a, 8b, 9b, 8c, 9c) qui est conçue pour recevoir un signal d'attaque provenant d'un circuit d'attaque associé (6a, 7a, 6b, 7b, 6c, 7c) de l'étage de sortie d'onduleur (2). Les circuits d'attaque (6a, 7a, 6b, 7b, 6c, 7c) de l'étage de sortie d'onduleur (2) contiennent chacun une logique de sécurité (10a, 11a, 10b, 11b, 10c, 11c) qui est conçue pour recevoir un signal de configuration provenant du processeur (12) du dispositif de décharge (1) par l'intermédiaire de l'interface, lequel signal de configuration configure le signal d'attaque à émettre par le circuit d'attaque (6a, 7a, 6b, 7b, 6c, 7c) vers l'entrée de commande associée (8a, 9a, 8b, 9b, 8c, 9c) du commutateur à semi-conducteur (4a, 5a, 4b, 5b, 4c, 5c) afin de décharger le circuit haute tension.

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