WO2023155063 - SCAN CIRCUIT AND DISPLAY APPARATUS
National phase entry:
Publication Number
WO/2023/155063
Publication Date
24.08.2023
International Application No.
PCT/CN2022/076448
International Filing Date
16.02.2022
Title **
[English]
SCAN CIRCUIT AND DISPLAY APPARATUS
[French]
CIRCUIT DE BALAYAGE ET APPAREIL D'AFFICHAGE
Applicants **
BOE TECHNOLOGY GROUP CO., LTD.
No.10 Jiuxianqiao Rd., Chaoyang District
Beijing 100015, CN
CHENGDU BOE OPTOELECTRONICS TECHNOLOGY CO., LTD.
No.1188 Hezuo Rd., (West Zone), Hi-tech Development Zone
Chengdu, Sichuan 611731, CN
Inventors
XU, Guanghua
No.9 Dize Rd., BDA
Beijing 100176, CN
YU, Yang
No.9 Dize Rd., BDA
Beijing 100176, CN
XIE, Taofeng
No.9 Dize Rd., BDA
Beijing 100176, CN
Application details
| Total Number of Claims/PCT | * |
| Number of Independent Claims | * |
| Number of Priorities | * |
| Number of Multi-Dependent Claims | * |
| Number of Drawings | * |
| Pages for Publication | * |
| Number of Pages with Drawings | * |
| Pages of Specification | * |
| * | |
| * | |
International Searching Authority |
CNIPA
* |
| Applicant's Legal Status |
Legal Entity
* |
| * | |
| * | |
| * | |
| * | |
| Entry into National Phase under |
Chapter I
* |
| Translation |
|
Recalculate
* The data is based on automatic recognition. Please verify and amend if necessary.
** IP-Coster compiles data from publicly available sources. If this data includes your personal information, you can contact us to request its removal.
Quotation for National Phase entry
| Country | Stages | Total | |
|---|---|---|---|
| China | Filing | 1399 | |
| EPO | Filing, Examination | 9370 | |
| Japan | Filing | 591 | |
| South Korea | Filing | 482 | |
| USA | Filing, Examination | 2710 |
Total: 14552 USD
The term for entry into the National Phase has expired. This quotation is for informational purposes only
Abstract[English]
A scan circuit is provided, including first, second and third control signal driving circuits; wherein, in a first region, the first control signal driving circuit includes L stages, L being an integer ≥ 1; in a second region, the second control signal driving circuit includes M1 stages and the third control signal driving circuit includes M2 stages, M1, M2 each being an integer ≥ 1; in a third region, the first control signal driving circuit includes N1 stages, the second control signal driving circuit includes N2 stages, and the third control signal driving circuit includes N3 stages, N1, N2, N3 each being an integer ≥ 2; and the first region, the second region, and the third region surround a first portion, a second portion, and a third portion of a perimeter of a display region, respectively, the first portion, the second portion, and the third portion being at least partially non-overlapping.[French]
La présente invention concerne un circuit de balayage qui comprend des premier, deuxième et troisième circuits d'attaque de signal de commande. Dans une première région, le premier circuit d'attaque de signal de commande comprend L étages, L étant un nombre entier ≥ 1 ; dans une deuxième région, le deuxième circuit d'attaque de signal de commande comprend M1 étages et le troisième circuit d'attaque de signal de commande comprend M2 étages, M1 et M2 étant chacun un nombre entier ≥ 1 ; dans une troisième région, le premier circuit d'attaque de signal de commande comprend N1 étages, le deuxième circuit d'attaque de signal de commande comprend N2 étages, et le troisième circuit d'attaque de signal de commande comprend N3 étages, N1, N2 et N3 étant chacun un nombre entier ≥ 2 ; et la première région, la deuxième région et la troisième région entourent une première partie, une deuxième partie et une troisième partie d'un périmètre d'une région d'affichage, respectivement, la première partie, la deuxième partie et la troisième partie étant au moins partiellement dans un état de non chevauchement.