WO2025202999 - PACKET BUFFER LATENCY MITIGATION IN A NETWORK DEVICE
National phase entry is expected:
Publication Number
WO/2025/202999
Publication Date
02.10.2025
International Application No.
PCT/IB2025/053315
International Filing Date
28.03.2025
Title **
[English]
PACKET BUFFER LATENCY MITIGATION IN A NETWORK DEVICE
[French]
ATTÉNUATION DE LATENCE DE MÉMOIRE TAMPON DE PAQUETS DANS UN DISPOSITIF RÉSEAU
Applicants **
MARVELL ASIA PTE LTD
Inventors
SCHRODER, Jacob Jul
Priority Data
63/571,232
28.03.2024
US
Application details
| Total Number of Claims/PCT | * |
| Number of Independent Claims | * |
| Number of Priorities | * |
| Number of Multi-Dependent Claims | * |
| Number of Drawings | * |
| Pages for Publication | * |
| Number of Pages with Drawings | * |
| Pages of Specification | * |
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| Number of Office Actions | * |
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International Searching Authority |
EPO
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| Recordal of a Change of the Applicant's Name/Address |
Change of Applicant's Name and Address
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| Type of Assignment |
The Standard Agent's Assignment
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| Applicant's Legal Status |
Legal Entity
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| Entry into National Phase under |
Chapter I
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| Patent Delivery |
Send the Letters Patent by Courier
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| 译文 |
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Quotation for National Phase entry
| Country | Stages | Total | |
|---|---|---|---|
| China | Filing, Examination, Granting | 2306 | |
| EPO | Filing, Examination, Granting | 11160 | |
| Japan | Filing, Examination, Granting | 2309 | |
| South Korea | Filing, Examination, Granting | 2385 | |
| USA | Filing, Examination, Granting | 4740 |
Total:
22,900
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Abstract[English]
A network device includes a plurality of network interfaces and an ingress processor configured to process packets received by the network device to determine network interfaces, among the plurality of network interfaces, via which the packets are to be transmitted by the network device. The network device also includes a memory device configured to buffer packet data corresponding to the packets while the packets are being processed by the network device and a memory controller configured to select a buffering scheme for buffering a packet in the memory device based on a congestion state of a network interface via which the packet is to be transmitted. The buffering scheme is selected among a first buffering scheme having a first latency associated with buffering packet data and a second buffering scheme having a second latency, smaller than the first latency, associated with buffering packet data.[French]
L'invention concerne un dispositif réseau comprenant une pluralité d'interfaces réseau et un processeur d'entrée configuré pour traiter des paquets reçus par le dispositif réseau afin de déterminer des interfaces réseau, parmi la pluralité d'interfaces réseau, par l'intermédiaire desquelles les paquets doivent être transmis par le dispositif réseau. Le dispositif réseau comprend également un dispositif mémoire configuré pour mettre en mémoire tampon des données de paquet correspondant aux paquets pendant le traitement des paquets par le dispositif réseau et un contrôleur de mémoire configuré pour sélectionner un schéma de mise en mémoire tampon pour mettre en mémoire tampon un paquet dans le dispositif mémoire sur la base d'un état de congestion d'une interface réseau par l'intermédiaire de laquelle le paquet doit être transmis. Le schéma de mise en mémoire tampon est sélectionné parmi un premier schéma de mise en mémoire tampon ayant une première latence associée à la mise en mémoire tampon de données de paquet et un second schéma de mise en mémoire tampon ayant une seconde latence, inférieure à la première latence, associée à la mise en mémoire tampon de données de paquet.