WO2026103991 - SCHALTUNGSANORDNUNG ZUR ANSTEUERUNG EINER HALBBRÜCKENSCHALTUNG

National phase entry is expected:
Publication Number WO/2026/103991
Publication Date 21.05.2026
International Application No. PCT/DE2025/101024
International Filing Date 05.11.2025
Title **
[German] SCHALTUNGSANORDNUNG ZUR ANSTEUERUNG EINER HALBBRÜCKENSCHALTUNG
[English] CIRCUIT ARRANGEMENT FOR ACTIVATING A HALF-BRIDGE CIRCUIT
[French] AGENCEMENT DE CIRCUIT POUR ACTIVER UN CIRCUIT EN DEMI-PONT
Applicants **
SCHAEFFLER TECHNOLOGIES AG & CO. KG
Inventors
WUNDERLICH, Andreas
Priority Data
102024210861.8   12.11.2024   DE
Application details
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译文

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Quotation for National Phase entry

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China Filing, Examination, Granting1880
EPO Filing, Examination, Granting8113
Japan Filing, Examination, Granting1968
South Korea Filing, Examination, Granting1693
USA Filing, Examination, Granting4740
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Abstract[German] Die Erfindung betrifft eine Schaltungsanordnung (5) mit einer Überwachungseinrichtung (20) zur Überwachung einer Ansteuereinrichtung (1 ) für einer Halbbrückenschaltung (3), wobei die Ansteuereinrichtung (1 ) dazu ausgebildet ist, Ansteuersignale für Highside- und Lowside-Gate-Treiber (HSGD, LSGD) zur Ansteuerung von Highside- und Lowside-FET-Schaltern (HST, LST) der Halbbrückenschaltung (3) zu erzeugen, und wobei die Überwachungseinrichtung (20) dazu ausgebildet ist, ein Abschaltung/Freigabe-Steuersignal (DISset) zur Steuerung einer Abschaltung/Freigabe der Gate-Treiber (HSGD, LSGD) zu erzeugen. Erfindungsgemäß ist vorgesehen, dass die integrierte Schaltung (10) ferner eine Signalverarbeitungseinrichtung (30) umfasst, die dazu ausgebildet ist, basierend auf dem Abschaltung/Freigabe-Steuersignal (DISset) Highside- und Lowside-Abschaltung/Freigabe-Signale (HSdis. LSdis) für die Highside- und Lowside-Gate-Treiber (HSGD, LSGD) zu erzeugen, derart, dass bei einem Wechsel des Abschaltung/Freigabe-Steuersignals (DISset) zur Abschaltung der Gate-Treiber (HSGD, LSGD) das Highside-Abschaltung/Freigabe-Signal (HSdis) unmittelbar wechselt und das Lowside-Abschaltung/Freigabe-Signal (LSdis) nach einer Verzögerung (Δtdis) wechselt, wohingegen bei einem Wechsel des Abschaltung/Freigabe-Steuersignals (DISset) zur Freigabe der Gate-Treiber (HSGD, LSGD) das Lowside-Abschaltung/Freigabe-Signal (LSdis) unmittelbar wechselt und das Highside-Abschaltung/Freigabe-Signal (HSdis) nach einer zeitlichen Verzögerung (Aten) wechselt.[English] The invention relates to a circuit arrangement (5) comprising a monitoring device (20) for monitoring an activating device (1) for a half-bridge circuit (3) , wherein the activating device (1) is designed to generate activation signals for high-side and low-side gate drivers (HSGD, LSGD) for activating high-side and low-side FET switches (HST, LST) of the half-bridge circuit (3), and wherein the monitoring device (20) is designed to generate a disable/enable control signal (DISset) for controlling a disabling/enabling of the gate drivers (HSGD, LSGD). According to the invention, it is provided that the integrated circuit (10) also comprises a signal processing device (30), which is designed to generate, on the basis of the disable/enable control signal (DISset), high-side and low-side disable/enable signals (Hsdis, LSdis) for the high-side and low-side gate drivers (HSGD, LSGD) in such a way that, when the disable/enable control signal (DISset) changes to disable the gate drivers (HSGD, LSGD), the high-side disable/enable signal (HSdis) changes immediately and the low-side disable/enable signal ( LSdis) changes after a delay (Δtdis), whereas, when the disable/enable control signal (DISset) changes to enable the gate drivers (HSGD, LSGD), the low-side disable/enable signal (LSdis) changes immediately and the high-side disable/enable signal (HSdis) changes after a time delay (Aten).[French] L'invention concerne un agencement (5) de circuit comprenant un dispositif (20) de surveillance destiné à surveiller un dispositif (1) d’activation pour un circuit (3) en demi-pont, le dispositif (1) d’activation étant conçu pour générer des signaux d'activation pour des pilotes de grille côté haut et côté bas (HSGD, LSGD) pour activer des commutateurs FET côté haut et côté bas (HST, LST) du circuit (3) en demi-pont, et le dispositif (20) de surveillance étant conçu pour générer un signal de commande de désactivation/d'activation (DISset) pour commander une désactivation/d'activation des pilotes de grille (HSGD, LSGD). Selon l'invention, il est prévu que le circuit intégré (10) comprenne également un dispositif de traitement de signal (30), qui est conçu pour générer, sur la base du signal de commande de désactivation/d'activation (DISset), des signaux de désactivation/d'activation côté haut et côté bas (Hsdis, LSdis) pour les pilotes de grille côté haut et côté bas (HSGD, LSGD) de telle sorte que, lorsque le signal de commande de désactivation/d'activation (DISset) change pour désactiver les pilotes de grille (HSGD, LSGD), le signal de désactivation/d'activation côté haut (HSdis) change immédiatement et le signal de désactivation/d'activation côté bas (LSdis) change après un retard (Δtdis), tandis que, lorsque le signal de commande de désactivation/d'activation (DISset) change pour activer les pilotes de grille (HSGD, LSGD), le signal de désactivation/d'activation côté bas (LSdis) change immédiatement et le signal de désactivation/d'activation côté haut (HSdis) change après un retard temporel (Aten).